淺談Vivado 綜合選項的7種設置

-flatten_hierarchy

full: 綜合時將原始設計打平，只保留頂層層次，執(zhí)行邊界優(yōu)化
none: 綜合時完全保留原始設計層次，不執(zhí)行邊界優(yōu)化
rebuilt: 綜合時將原始設計打平，執(zhí)行邊界優(yōu)化，綜合后將網表文件按照原始層次顯示，故與原始層次相似。

當-flatten_hierarchy為none時消耗的寄存器最多，建議其設定為默認值rebuilt。

-fsm_extraction

用于設定狀態(tài)機的編碼方式，默認值為auto。
-fsm_encoding
功能同上，優(yōu)先級高于-fsm_extraction，但如果代碼本身已經定義了編碼方式，該設定將無效。
one-hot:任意狀態(tài)只有一個比特位置一。

-keep_equivalent_registers

equivalent registers，等效寄存器，即共享輸入數據的寄存器。
勾選時，等效寄存器不合并；
不勾選時，等效寄存器合并。
等效寄存器可以有效的降低扇出，可以通過綜合屬性keep避免其被合并。

-resource_sharing

其目的是對算術運算通過資源共享優(yōu)化設計資源
auto
on
off

-control_set_opt_threshold

觸發(fā)器的控制集由時鐘信號、復位/置位信號和使能信號構成，通常只有{clk，set/rst，ce}均相同的觸發(fā)器才可以被放置在一個SLICE中。
control_set_opt_threshold的值為控制信號（不包括時鐘和數據）的扇出個數，表明對小于此值的同步信號進行優(yōu)化，顯然此值越大，被優(yōu)化的觸發(fā)器越多，但占用的查找表也越多。
control_set_opt_threshold的值為0，不進行優(yōu)化。
auto:默認值。

-no_lc

對于一個x輸入布爾表達式和一個y輸入的布爾表達式，只要滿足x + y ≤5（相同變量只算一次），這兩個布爾表達式就可以放置在一個LUT6中實現。
當-no_lc被勾選時，則不允許出現LUT整合。
通過LUT整合可以降低LUT的資源消耗率，但也可能導致布線擁塞。因此，xilinx建議，當整合的LUT超過了LUT總量的15%時，應考慮勾選-no_lc,關掉LUT整合。

-shreg_min_size

shreg_min_size決定了當VHDL代碼描述的移位寄存器深度大于此設定值時，將采用“觸發(fā)器+SRL+觸發(fā)器”的方式實現。

編輯：hfy