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      教你們怎么去設(shè)定寄存器的初始值

      FPGA技術(shù)驛站 ? 來源：Teacher Gao ? 作者：Teacher Gao ? 2021-04-01 10:27 ? 次閱讀

      對于寄存器，如果沒有明確指定其初始值，Vivado會根據(jù)其類型（FDCE/FDRE/FDPE/FDRE）設(shè)定合適的初始值。有些工程師喜歡使用復位信號，對所有的寄存器進行上電復位，使其在處理數(shù)據(jù)之前達到期望初始狀態(tài)。但這會有一個不利之處就是復位信號的扇出很大，從而消耗了大量的布線資源，甚至造成布線擁塞。那么能不能讓寄存器在上電之后不用通過復位就輸出期望值呢？答案是肯定的。

      Xilinx也建議對于同步元件，最好設(shè)定其初始值。這里我們以最常用的寄存器為例。如果使用的是VHDL，可以采用下面的方法設(shè)定寄存器初始值，如下圖所示。

      ccd385aa-923c-11eb-8b86-12bb97331649.png

      如果使用的是Verilog，可以采用下面的方法設(shè)定寄存器初始值，如下圖所示。

      ccdf4f48-923c-11eb-8b86-12bb97331649.png

      此外，對于Verilog，也可通過initial設(shè)定初始值，如下圖所示。

      ccedec4c-923c-11eb-8b86-12bb97331649.png

      采用這種方法的好處是：綜合工具是支持的，這樣生成bit文件時這些初始值會被寫入配置文件中，上電即可生效，避免了使用復位造成的扇出過大；同時在仿真時，也能跟實際業(yè)務(wù)相匹配。 為了驗證這個方法是否生效，只需要打開綜合后的.dcp，找到相應(yīng)的寄存器，在其Property窗口中查看屬性INIT的值，如下圖所示。

      ccff28e0-923c-11eb-8b86-12bb97331649.png

      編輯：jq

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      原文標題：如何設(shè)定寄存器的初始值？

      文章出處：【微信號：Lauren_FPGA，微信公眾號：FPGA技術(shù)驛站】歡迎添加關(guān)注！文章轉(zhuǎn)載請注明出處。

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