MIPI CSI-2架構(gòu)設(shè)計(jì)(一)

通常Camera采集到的圖像，需要解碼輸入到SoC系統(tǒng)進(jìn)行圖像算法處理。

本期簡單描述下SoC系統(tǒng)與MIPI CSI-2 compliant Camera Sensor對接的電路設(shè)計(jì)架構(gòu)，后面接著講講MIPI DSI顯示系統(tǒng)架構(gòu)設(shè)計(jì)，用于驅(qū)動OLED、LCD等顯示屏。

回到MIPI CSI-2 compliant Camera Sensor對接的電路設(shè)計(jì)架構(gòu)：

PHY RX: 物理設(shè)計(jì)部分，serdes，串并轉(zhuǎn)換。

De-Skew/ Pipeline: deskew功能，完成幾路數(shù)據(jù)對齊。對齊到時鐘rxbyteclkhs/rxwordclkhs。請思考下最大支持的skew為多少cycle?為什么？參考全棧芯片工程師知識星球。

Pipeline: 將PPI高速信號(rxdatahs_x, rxvalidhs_x, errsoths_x,errsotsynchs_x) 打拍，解決SoC的接口timing問題。

Descrambler: 可配置使能，如果使能，可將PPI接口的加擾數(shù)據(jù)轉(zhuǎn)換為原始數(shù)據(jù)，采用LFSR算法，注意seed，思考下加擾/解擾如何實(shí)現(xiàn)的，具體參見全棧芯片工程師知識星球。

緊接著就是精彩的PHY Adaptation Layer、Packet Analyzer模塊，完成data lanes merging，header解碼，ECC糾錯，檢測frame sizer、CRC錯誤。具體參見全棧芯片工程師知識星球。

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實(shí)戰(zhàn)MCU+ISP圖像處理芯片版圖

實(shí)戰(zhàn)ISP圖像算法效果

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