Western Digital發(fā)表基于RISC-V架構(gòu)開發(fā)的三項(xiàng)開源技術(shù)

Western Digital Corp.(NASDAQ：WDC)在RISC-V Summit大會上發(fā)表了三項(xiàng)創(chuàng)新的開源技術(shù)，專為支持Western Digital內(nèi)部RISC-V架構(gòu)開發(fā)專案，以及日益成長的RISC-V架構(gòu)生態(tài)系統(tǒng)所設(shè)計的。

Western Digital技術(shù)長Martin Fink宣布為推動網(wǎng)絡(luò)儲存快取連貫性(cache coherent)與RISC-V架構(gòu)指令集模擬器(Instruction Set Simulator)對應(yīng)的開源標(biāo)準(zhǔn)，將計畫性開放新的RISC-V核心原始碼。這些創(chuàng)新技術(shù)將有助于加速業(yè)界發(fā)展新的專用化開源運(yùn)算架構(gòu)，以因應(yīng)大數(shù)據(jù)(Big Data)與快數(shù)據(jù)(Fast Data)的環(huán)境。近來Western Digital積極協(xié)助推廣RISC-V架構(gòu)生態(tài)系統(tǒng)，穩(wěn)健地朝向?qū)?0億個核心處理器移轉(zhuǎn)至RISC-V架構(gòu)的預(yù)定目標(biāo)前進(jìn)。

Western Digital的RISC-V SweRV Core。

Western Digital技術(shù)長Martin Fink指出，隨著大數(shù)據(jù)和快數(shù)據(jù)應(yīng)用不斷增加，若要從現(xiàn)今各式以數(shù)據(jù)為中心的應(yīng)用程序中發(fā)掘出數(shù)據(jù)的真正價值，專用化技術(shù)則是不可或缺的關(guān)鍵。Western Digital的SweRV Core與全新透過網(wǎng)絡(luò)構(gòu)造的快取連貫性技術(shù)，展現(xiàn)了讓數(shù)據(jù)更貼近運(yùn)算處理的強(qiáng)大可行性。這些規(guī)劃性對開源社群的發(fā)展貢獻(xiàn)以及RISC-V架構(gòu)的持續(xù)投入，可加速合作創(chuàng)新與數(shù)據(jù)導(dǎo)向的發(fā)展并帶來令人驚艷的潛力。

Western Digital計畫將開放其采用雙向超純量(superscalar)設(shè)計的全新RISC-V SweRV Core原始碼。Western Digital的RISC-V SweRV Core是一個32位元、9階管線的核心，可同時加載并執(zhí)行多個指令以縮短程序執(zhí)行時間。它是一個精簡、循序執(zhí)行的核心，執(zhí)行速度4.9 CoreMarks/Mhz，其低功耗的設(shè)計可在28mm CMOS制程技術(shù)下提供高達(dá)1.8Ghz的時脈。Western Digital計畫將SweRV Core納入內(nèi)部各種嵌入式設(shè)計中。將該核心原始碼對開源社群開放，預(yù)期將可帶動新的以數(shù)據(jù)為中心的應(yīng)用發(fā)展。

Western Digital的OmniXtend則是一個新的開源技術(shù)，可透過網(wǎng)絡(luò)結(jié)構(gòu)實(shí)現(xiàn)快取連貫性儲存。這套存儲器導(dǎo)向的系統(tǒng)架構(gòu)所提供的開源接口標(biāo)準(zhǔn)可讓多個處理器、機(jī)器學(xué)習(xí)加速器、繪圖處理器(GPU)、FPGA及其它元件存取與分享數(shù)據(jù)。這是一個能夠有效率的讓持續(xù)存儲器附屬到處理器的開源解決方案，并有潛力發(fā)展成可支持未來運(yùn)算、儲存、存儲器與I/O元件連接的進(jìn)階構(gòu)造。

此外，Western Digital亦推出一套開源SweRV指令集模擬器(SweRV ISS)，為使用RISC-V核心的開發(fā)人員提供了完整的測試平臺。Western Digital利用SweRV ISS執(zhí)行超過100億個指令來嚴(yán)格模擬與驗(yàn)證SweRV Core，也期望SweRV Core和SweRV ISS將有助于業(yè)界加速采用開源指令集架構(gòu)。

IDC技術(shù)與半導(dǎo)體部門計畫副總裁Mario Morales表示，速度、數(shù)據(jù)量與強(qiáng)力運(yùn)算對于邊緣和終端運(yùn)算來說，已不再是絕對成功的方程序。隨著越來越多數(shù)據(jù)朝終端移動以進(jìn)行實(shí)時運(yùn)算和推論，采用可彈性組態(tài)的架構(gòu)將更能滿足繁重且經(jīng)常變動的應(yīng)用工作負(fù)載，尤其是人工智能和物聯(lián)網(wǎng)相關(guān)應(yīng)用。能源效率、可組態(tài)性以及低功耗，將成為邊緣與終端運(yùn)算架構(gòu)的關(guān)鍵要素。