ADI的AD7626 PulSAR? ADC使16位數(shù)據(jù)采集性能達到新的高度,并提供同類最佳的15位ENOB(有效位數(shù))和10 MSPS(每秒百萬采樣)吞吐速率,速度比其它SAR ADC快2.5倍。
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發(fā)表于 07-27 09:43
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示波器顯示約為2mVpp的噪聲,為什么AD7626只讀取到了5LSB呢?
,請問一般是什么原因呢?是AD7626的分辨率很好,但是精度沒有那么好嗎?
另外還想請教一個基礎(chǔ)知識:ADC理想的傳輸函數(shù)中,1/2 LSB時候輸出代碼會轉(zhuǎn)換,但是從圖中可以看到,6/8和7/8中間輸出代碼就會轉(zhuǎn)換到最大了即1
發(fā)表于 07-26 06:38
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發(fā)表于 07-12 10:06
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請問AD7626與FPGA如何對接?
AD7626的數(shù)字接口分為自時鐘模式和回波時鐘模式。
但是作為FPGA只能提供一個連續(xù)的250M clk+/-,因此存在以下2個問題:
在回波時鐘模式下,AD7626沒有提供幀頭,F(xiàn)PGA接收
發(fā)表于 12-22 06:34
關(guān)于AD7626 VCM輸出的疑問求解
大家好,上圖是我根據(jù)AD7626手冊設(shè)計的電路圖,[size=13.3333339691162px]設(shè)計使用ADA4932-1來驅(qū)動AD7626,拿到板子時,測試沒有問題,一切管腳電壓都ok
發(fā)表于 12-19 07:09
AD7626手冊上是10M轉(zhuǎn)換速率,是只有這一種工作模式嗎?
1、AD7626手冊上是10M轉(zhuǎn)換速率,是只有這一種工作模式嗎?
2、嘗試用fpga實現(xiàn)數(shù)據(jù)采集接口,采取回波模式,預(yù)設(shè)一次轉(zhuǎn)換200ns,clk輸出100M
發(fā)表于 12-15 07:15
請問AD7626 FPGA LVDS電平標準如何選擇?
我需要用 Xilinx FPGA 與 AD7626 接口,之間有 CNV、CLK、DCO、D 四對 LVDS 信號,請問 FPGA 里應(yīng)該采用怎樣的 LVDS 電平標準與 AD7626 匹配?
發(fā)表于 12-08 07:24
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發(fā)表于 11-29 09:21
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