--- 產(chǎn)品參數(shù) ---
- 輸入電壓范圍 2.3 V至5.5 V
- 輸出電壓范圍 0.8 V至5.2 V
- 封裝 LFCSP
--- 產(chǎn)品詳情 ---
ADP5023在一個24引腳4 mm × 4 mm小型LFCSP封裝中集成了兩個高性能降壓調節(jié)器和一個低壓差調節(jié)器(LDO),可滿足嚴苛的性能和電路板空間要求。
降壓調節(jié)器的高開關頻率支持小型多層外部器件,并使電路板空間降至較小。當MODE引腳設置為高電平時,降壓調節(jié)器以強制PWM模式工作。當MODE引腳設置為低電平時,如果負載電流高于預定義閾值,則降壓調節(jié)器以PWM模式工作;當負載電流降至預定義閾值以下時,調節(jié)器以省電模式(PSM)工作,以便改善輕負載效率。
為降低輸入電容要求,兩個降壓器以錯相工作。ADP5023 LDO的低靜態(tài)電流、低壓差和寬輸入電壓范圍可延長便攜式設備的電池使用時間。在頻率高達10 kHz時,ADP5023 LDO能保持60 dB以上的電源抑制性能,而所需的電壓裕量則很低。
ADP5023中的調節(jié)器通過專用使能引腳激活??烧{版本的默認輸出電壓可以在外部設置,固定電壓版本的默認輸出電壓則可在工廠編程設置;預設值范圍廣泛。
應用
- 適用于處理器、ASIC、FPGA和RF芯片組的電源
- 便攜式儀器儀表和醫(yī)療設備
- 空間受限器件
- 主要輸入電壓范圍:2.3 V至5.5 V
- 兩個800 mA降壓調節(jié)器和一個300 mA LDO
- 24引腳4 mm × 4 mm LFCSP封裝
- 穩(wěn)壓器精度: ±1.8%
- 工廠編程設置或外部可調的VOUTx
- 3 MHz降壓工作,支持強制PWM模式和自動PWM/PSM模式
- BUCK1/BUCK2:輸出電壓范圍為0.8 V至3.8 V
- LDO:輸出電壓范圍0.8 V至5.2 V
- LDO:低輸入電源電壓范圍為1.7 V至5.5 V
- LDO:高PSRR、低輸出噪聲
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