資料介紹
隨著FPGA 技術(shù)和自動設(shè)計工具的進步,數(shù)字電子系統(tǒng)設(shè)計的方法正在發(fā)生變化。
越來越多的工程師開始使用硬件描述語言和高級綜合工具進行設(shè)計。Verilog HDL 作為一種流行的硬件描述語言,在數(shù)字系統(tǒng)設(shè)計特別是FPGA 設(shè)計中有著廣泛的應(yīng)用。本文主要介紹了用Verilog HDL 進行FPGA 設(shè)計和優(yōu)化的一些實用方法,最后還介紹了IP 核復(fù)用技術(shù)在FPGA 設(shè)計中的應(yīng)用。
關(guān)鍵詞:Verilog 硬件描述語言, FPGA 設(shè)計,IP 核復(fù)用,設(shè)計優(yōu)化,綜合
當前,以大規(guī)???a href='http://srfitnesspt.com/v/tag/1315/' target='_blank' class='arckwlink_none'>編程邏輯器件和 EDA 工具為基礎(chǔ)的設(shè)計方法已經(jīng)成為發(fā)展的趨勢。
FPGA 做為一種高密度的可編程器件,以其優(yōu)越的性能和可反復(fù)編程的特點,在復(fù)雜數(shù)字系統(tǒng)設(shè)計中得到了越來越廣泛的應(yīng)用。隨著電子系統(tǒng)設(shè)計正逐漸向大規(guī)模和高復(fù)雜度方向發(fā)展,傳統(tǒng)的使用原理圖的方式進行FPGA 設(shè)計已經(jīng)越來越不能滿足設(shè)計的要求。Verilog HDL作為一種IEEE 標準的硬件描述語言,特別適合進行大規(guī)模的FPGA 設(shè)計。本文主要從實用的角度出發(fā),對用Verilog HDL 進行FPGA 設(shè)計的基本方法和基本思想做了一些總結(jié)。
越來越多的工程師開始使用硬件描述語言和高級綜合工具進行設(shè)計。Verilog HDL 作為一種流行的硬件描述語言,在數(shù)字系統(tǒng)設(shè)計特別是FPGA 設(shè)計中有著廣泛的應(yīng)用。本文主要介紹了用Verilog HDL 進行FPGA 設(shè)計和優(yōu)化的一些實用方法,最后還介紹了IP 核復(fù)用技術(shù)在FPGA 設(shè)計中的應(yīng)用。
關(guān)鍵詞:Verilog 硬件描述語言, FPGA 設(shè)計,IP 核復(fù)用,設(shè)計優(yōu)化,綜合
當前,以大規(guī)???a href='http://srfitnesspt.com/v/tag/1315/' target='_blank' class='arckwlink_none'>編程邏輯器件和 EDA 工具為基礎(chǔ)的設(shè)計方法已經(jīng)成為發(fā)展的趨勢。
FPGA 做為一種高密度的可編程器件,以其優(yōu)越的性能和可反復(fù)編程的特點,在復(fù)雜數(shù)字系統(tǒng)設(shè)計中得到了越來越廣泛的應(yīng)用。隨著電子系統(tǒng)設(shè)計正逐漸向大規(guī)模和高復(fù)雜度方向發(fā)展,傳統(tǒng)的使用原理圖的方式進行FPGA 設(shè)計已經(jīng)越來越不能滿足設(shè)計的要求。Verilog HDL作為一種IEEE 標準的硬件描述語言,特別適合進行大規(guī)模的FPGA 設(shè)計。本文主要從實用的角度出發(fā),對用Verilog HDL 進行FPGA 設(shè)計的基本方法和基本思想做了一些總結(jié)。
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