資料介紹
7系列FPGA GTZ收發(fā)器的可定制的Logicore?IP Chipscope?Pro集成誤碼率測試(IBert)內核用于評估和監(jiān)控GTZ收發(fā)器。該核心包括在FPGA邏輯中實現的模式生成器和校驗器,以及對端口的訪問和GTZ收發(fā)器的動態(tài)重新配置端口屬性。還包括通信邏輯,允許通過JTAG對設計進行運行時訪問。根據客戶配置和本文檔中的描述,此核心可以用作獨立的或開放的設計。
Ibert核心設計用于需要驗證或評估7系列FPGA GTZ收發(fā)器的任何應用。
Ibert核心為7系列FPGA GTZ收發(fā)器提供了一個廣泛的物理介質附件(PMA)評估和演示系列??梢詤祷厥褂貌煌腉TZ收發(fā)器和時鐘拓撲結構,也可以自定義ibret核心,以使用不同的線路速率、參考時鐘速率和邏輯寬度。每個所需的GTZ收發(fā)器都包含數據模式生成器和校驗器,提供了許多不同的偽隨機二進制序列(PRB)和要通過通道發(fā)送的時鐘模式。此外,可以通過與GTZ收發(fā)器的DRP端口通信的邏輯訪問GTZ收發(fā)器的配置和調整,以更改屬性設置,以及控制端口上的值的寄存器。在運行時,Chipscope Analyzer工具通過JTAG,使用作為Ibert核心一部分的xilinx電纜和專有邏輯與Ibert核心進行通信。
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