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      電子發(fā)燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>FPGA的發(fā)展概述和設計資料說明

      FPGA的發(fā)展概述和設計資料說明

      2020-10-09 | rar | 3.66 MB | 次下載 | 免費

      資料介紹

      　　處理流程輸入數(shù)據(jù)流通過“輸入數(shù)據(jù)選擇單元”將數(shù)據(jù)流等時分配到兩個數(shù)據(jù)緩沖區(qū)，數(shù)據(jù)緩沖模塊可以為仼何存儲模塊，比較常用的存儲單元為雙口RAM（ DPRAM?單口RAM（ SPRAM）、FIFO等在第1個緩沖周期，將輸入的數(shù)據(jù)流緩存到“數(shù)據(jù)緩沖模塊1冫在第2個緩沖周期，通過“輸入數(shù)據(jù)選擇單元″的切換，將輸入的數(shù)據(jù)流緩存到“數(shù)據(jù)緩沖模塊2″，同時將“數(shù)據(jù)綬沖模塊1″緩存的第1個周期數(shù)據(jù)通過“輸入數(shù)據(jù)選擇單元”的選擇，送到“數(shù)據(jù)流運算處理模塊″進行運算處理;在第3個緩沖周期通過輸入數(shù)據(jù)選擇單元″的再次切換，將輸入的數(shù)據(jù)流緩存到“數(shù)據(jù)緩沖模塊1″，同時將¨數(shù)據(jù)緩沖模塊?″緩存的第2個周期的數(shù)據(jù)通過“輸λ數(shù)據(jù)選擇單元″切換，送到“數(shù)據(jù)流運算處理模塊″迸行運算處理。如此循環(huán)。

      　　優(yōu)點經過緩沖的數(shù)據(jù)流沒有時間停頓，常常應用于流水線式算法節(jié)約緩沖區(qū)空間低速模塊處理高速數(shù)據(jù)流

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