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      電子發(fā)燒友網(wǎng)>電子資料下載>嵌入式開發(fā)>6位Flash型超高速ADC的設計

      6位Flash型超高速ADC的設計

      2021-08-04 | pdf | 55.87KB | 次下載 | 5積分

      資料介紹

      6位Flash型超高速ADC的設計-

      作為模擬與數(shù)字電路的接口電路的關鍵部分，模數(shù)轉換器（ADC）現(xiàn)代通信、需達、盧納以及眾多消費電子產(chǎn)品中都占據(jù)極其重要的地位。隨著科技的迅猛發(fā)展，對模數(shù)轉換器的性能，特別是速度上的要求越來越高，ADC的性能好壞甚至已經(jīng)成為決定設備性能的關鍵因素。

      本文以超高速ADC作為設計的目標，采用了Flash型結構作為研究的方向，并且從ADC的速度和失調(diào)電壓消除技術入手進行了重點研究。本文采用了種新穎的消除失調(diào)電壓的技術-chopping技術，該技術主要是依靠 組隨機數(shù)產(chǎn)生器所產(chǎn)生的高速隨機數(shù)序列來隨機快速置換比較器輸入端，從而使得失調(diào)電壓近似平均為零，本文設計了種高速隨機數(shù)產(chǎn)生器，可以產(chǎn)生速率達到1GHz的隨機數(shù)序列。由于比較器部分是影響整個ADC速度的關鍵因素，因此在設計中對于比較器部分逃行了重點優(yōu)化設計。另外還在數(shù)字編碼電路中加入了糾錯設計。

      通過電路仿真，所設計的ADC可達到1GHz的采樣速率，最大積分非線性和微分非線性分別為0.42LSB和0.49LSB，當輸入信號頻率為16.6MHz時，無雜波動態(tài)范圍（SFDR）達到41dB，當加入50mV失調(diào)電壓時，chopping技術可以將SFDR增加3dB左右。

      本設計采用了和艦0.18um CMOS混合信號工藝，完成了主要模塊版圖的設計工作。

      關鍵詞 Flash型 ADC；失調(diào)電壓消除技術：chopping技術


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      6位Flash型超高速ADC的設計.pdf 3M
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