資料介紹
十進制同步加/減計數(shù)器(雙時鐘) 54192/74192
54LS192/74LS192
邏輯符號
簡要說明:
192 為 可 預(yù) 置 的 十 進 制 同 步 加 / 減 計 數(shù) 器 , 共 有
54192/74192,54LS192/74LS192 兩種線路結(jié)構(gòu)形式。其主要電
特性的典型值如下:
型號 fc PD
54192/74192 32MHz 325mW
54LS192/74LS192 32MHz 95mW
192 的清除端是異步的。當清除端(MR)為高電平時,
不管時鐘端(CPD、CPU)狀態(tài)如何,即可完成清除功能。
192 的預(yù)置是異步的。當置入控制端(P
__
L_
)為低電平時,
不管時鐘CP的狀態(tài)如何,輸出端(Q0~Q3)即可預(yù)置成與數(shù)據(jù)
輸入端(P0~P3)相一致的狀態(tài)。
192 的計數(shù)是同步的,靠CPD、CPU同時加在 4 個觸發(fā)器上
而實現(xiàn)。在CPD、CPU上升沿作用下Q0~Q3 同時變化,從而消
除了異步計數(shù)器中出現(xiàn)的計數(shù)尖峰。當進行加計數(shù)或減計數(shù)時
可分別利用CPD或CPU,此時另一個時鐘應(yīng)為高電平。
當計數(shù)上溢出時,進位輸出端(T
__
C_
U)輸出一個低電平脈
沖,其寬度為CPU低電平部分的低電平脈沖;當計數(shù)下溢出時,
錯位輸出端(T
__
C_
D)輸出一個低電平脈沖,其寬度為CPD低電
平部分的低電平脈沖。
當把T
__
C_
D和T
__
C_
U分別連接后一級的CPD、CPU,即可進行級聯(lián)。
54LS192/74LS192
邏輯符號
簡要說明:
192 為 可 預(yù) 置 的 十 進 制 同 步 加 / 減 計 數(shù) 器 , 共 有
54192/74192,54LS192/74LS192 兩種線路結(jié)構(gòu)形式。其主要電
特性的典型值如下:
型號 fc PD
54192/74192 32MHz 325mW
54LS192/74LS192 32MHz 95mW
192 的清除端是異步的。當清除端(MR)為高電平時,
不管時鐘端(CPD、CPU)狀態(tài)如何,即可完成清除功能。
192 的預(yù)置是異步的。當置入控制端(P
__
L_
)為低電平時,
不管時鐘CP的狀態(tài)如何,輸出端(Q0~Q3)即可預(yù)置成與數(shù)據(jù)
輸入端(P0~P3)相一致的狀態(tài)。
192 的計數(shù)是同步的,靠CPD、CPU同時加在 4 個觸發(fā)器上
而實現(xiàn)。在CPD、CPU上升沿作用下Q0~Q3 同時變化,從而消
除了異步計數(shù)器中出現(xiàn)的計數(shù)尖峰。當進行加計數(shù)或減計數(shù)時
可分別利用CPD或CPU,此時另一個時鐘應(yīng)為高電平。
當計數(shù)上溢出時,進位輸出端(T
__
C_
U)輸出一個低電平脈
沖,其寬度為CPU低電平部分的低電平脈沖;當計數(shù)下溢出時,
錯位輸出端(T
__
C_
D)輸出一個低電平脈沖,其寬度為CPD低電
平部分的低電平脈沖。
當把T
__
C_
D和T
__
C_
U分別連接后一級的CPD、CPU,即可進行級聯(lián)。
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