資料介紹
差分LVPECL時(shí)鐘驅(qū)動(dòng)器電路將一對(duì)差分LVPECL時(shí)鐘輸入(CLKIN,CLKIN)分配給九對(duì)差分時(shí)鐘(Y,Y)輸出,時(shí)鐘分配的偏斜最小。它專(zhuān)門(mén)設(shè)計(jì)用于驅(qū)動(dòng)50-2傳輸線(xiàn)。當(dāng)輸出使能(OE)為低電平時(shí),9路差分輸出以與差分時(shí)鐘輸入相同的頻率切換。當(dāng)OE為高電平時(shí),9個(gè)差分輸出處于靜態(tài)(Y輸出處于低電平狀態(tài),Y輸出處于高電平狀態(tài))。
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