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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>網(wǎng)絡(luò)協(xié)議論文>多核處理器片上Cache的選擇性復(fù)制策略

      多核處理器片上Cache的選擇性復(fù)制策略

      2009-03-25 | rar | 70 | 次下載 | 3積分

      資料介紹

      在統(tǒng)計(jì)分析8 個(gè)典型測試程序的模擬運(yùn)行的基礎(chǔ)上，提出在多核處理器的私有L1 上對部分只讀共享數(shù)據(jù)進(jìn)行復(fù)制以加快訪問速度，對讀-寫共享數(shù)據(jù)采用“原地通信”策略，以減少一致性開銷，針對其中的“寫無效化共享標(biāo)記”問題提出一種更簡單的解決方法。從模擬實(shí)驗(yàn)的統(tǒng)計(jì)分析可知，采用這2 種策略可獲得比傳統(tǒng)策略更小的平均訪問時(shí)延和更高的空間利用率。
      關(guān)鍵詞：對稱多處理器；選擇性復(fù)制；高速緩沖
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