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標(biāo)簽 > verilog hdl
Verilog HDL是一種硬件描述語言(HDL:Hardware Description Language),以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語言,用它可以表示邏輯電路圖、邏輯表達(dá)式,還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。
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2014-06-05 標(biāo)簽:講義Verilog HDL 1033 3
Verilog HDL數(shù)字設(shè)計(jì)與綜合課件(第二版)立即下載
2015-12-23 標(biāo)簽:數(shù)字設(shè)計(jì)Verilog HDL 1011 0
2016-07-15 標(biāo)簽:Verilog HDL 1002 0
2013-03-06 標(biāo)簽:VerilogVerilog HDL 930 7
2016-11-11 標(biāo)簽:VerilogVerilog HDL 928 0
基于可編程邏輯器件(FPGA)為核心的PS_2接口鍵盤的輸入輸出電路的設(shè)計(jì)立即下載
2015-08-20 標(biāo)簽:FPGAVGA接口Verilog HDL 891 1
基于Verilog HDL語言的ISE設(shè)計(jì)流程立即下載
2015-03-01 標(biāo)簽:ISE設(shè)計(jì)Verilog HDL 876 2
verilog_HDL課程設(shè)計(jì)之交通燈控制電路立即下載
2015-12-21 標(biāo)簽:verilog HDLHDL技術(shù) 855 0
應(yīng)用Verilog HDL進(jìn)行數(shù)字系統(tǒng)設(shè)計(jì)實(shí)例立即下載
2011-09-27 標(biāo)簽:數(shù)字系統(tǒng)Verilog HDL 835 0
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2021-04-30 標(biāo)簽:FPGAVerilog HDL 825 1
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2016-05-11 標(biāo)簽:Verilog HDL 810 0
2011-09-07 標(biāo)簽:Verilog HDL 807 0
有限狀態(tài)機(jī)設(shè)計(jì)是HDL Designer Series的關(guān)鍵應(yīng)用立即下載
2021-04-08 標(biāo)簽:HDL狀態(tài)機(jī)Verilog HDL 805 0
基于Verilog+HDL的SVPWM算法的設(shè)計(jì)與仿真立即下載
2015-08-20 標(biāo)簽:Verilog HDL電壓型逆變器 791 0
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2015-08-20 標(biāo)簽:FPGAVerilog HDL高斯白噪聲 789 2
FPGA 應(yīng)用開發(fā)入門與典型實(shí)例(修訂版)_第3章硬件描述語言 Verilog HDL基礎(chǔ)立即下載
2015-01-14 標(biāo)簽:FPGAVerilog HDL 776 0
2012-11-08 標(biāo)簽:VHDLVerilog HDL 768 4
Verilog HDL程序設(shè)計(jì)教程立即下載
2016-05-11 標(biāo)簽:Verilog HDL 762 0
Verilog HDL 經(jīng)典入門教材講義立即下載
2013-07-07 標(biāo)簽:仿真設(shè)計(jì)驗(yàn)證Verilog HDL 757 0
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