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如何尋找時序路徑的起點與終點

FPGA技術(shù)江湖 ? 來源:FPGA技術(shù)江湖 ? 作者:FPGA技術(shù)江湖 ? 2022-05-04 17:13 ? 次閱讀

今天看《集成電路時序分析與建?!分锌吹竭@么一個知識點,覺得有點意思,就記錄下來,與大家一起分享。

先看 如下電路圖:

ca813046-c471-11ec-bce3-dac502259ad0.jpg

左邊的電路圖是需要分析的電路,我們的目的是要對此電路進行時序分析,那首先要找到該電路需要分析的時序路徑,既然找路徑,那找到時序分析的起點與終點即可。

尋找時序路徑的起點和終點的原則如下:

起點:

設(shè)計邊界的數(shù)據(jù)輸入端口信號輸入端口;如上圖右邊的I0,I1;

時序元件(一般指DFF)的輸出,例如上圖右邊的11,13,15;

存儲單元的數(shù)據(jù)輸出,其實這和第2條一致,時序單元也是存儲單元,例如DFF,但這里的存儲單元一般指存儲器,例如RAM等;

終點:

時序單元的數(shù)據(jù)輸入,例如上圖右邊的10,12,14;

存儲單元的數(shù)據(jù)輸入,類似于時序單元,但更多指存儲器等,例如RAM等;

設(shè)計邊界的輸出Q0,Q1,Q2;

根據(jù)上述原則即可得到,時序分析的起點(最左邊)和終點(最右邊):

ca955de6-c471-11ec-bce3-dac502259ad0.jpg

時序路徑

中間經(jīng)過的節(jié)點都可認為是延遲單元。

實際進行時序分析時,可不必每次都這么轉(zhuǎn)換,但是不得不說,這種理論化的方式可以讓你的分析更具理論支撐,見多了熟悉了之后便可更快速的識別時序路徑。這是分析的第一步,祝入門快樂。

審核編輯 :李倩

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
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原文標題:【靜態(tài)時序分析】如何尋找時序路徑的起點與終點

文章出處:【微信號:HXSLH1010101010,微信公眾號:FPGA技術(shù)江湖】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

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