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Cadence allegro 17.2 3DPCB如何制作三維模型

電子工程師 ? 來(lái)源:未知 ? 作者:工程師李察 ? 2018-09-01 09:12 ? 次閱讀

眾所周知,Cadence allegro16.x 版本已經(jīng)擁有3D view,雖然比較簡(jiǎn)單,但是總之還不錯(cuò),近年以來(lái)Cadence公司在不斷的加強(qiáng) PCB Editor三維的顯示能力,可以幫助PCB工程師更直觀進(jìn)行PCB設(shè)計(jì)。終于,17.2版本的到來(lái),迎來(lái)了Cadence Allegro 3D設(shè)計(jì)的新紀(jì)元,其3D效果絲毫不弱于AD軟件的3D View。

工程師的巨大福利,首款P_C_B分析軟件,點(diǎn)擊免費(fèi)領(lǐng)取

一、準(zhǔn)備:allegro17.2 ,3D模型庫(kù)

二、設(shè)置及顯示

1、 首先要對(duì)使用環(huán)境進(jìn)行設(shè)置

1)env文件設(shè)置。路徑在:CadenceSPB_16.6sharepcb extenv,打開,查看是否有設(shè)置set step_unsupported_prototype 1,如果沒有,就在文件中加上。

2)Step模型路徑設(shè)置。如下圖示:

2、 設(shè)置PCB中的元器件與3D模型匹配

1)進(jìn)入匹配界面。如下圖示:

2)匹配設(shè)置

分別在上圖示位置選擇需要顯示3d效果的器件進(jìn)行匹配,對(duì)各參數(shù)進(jìn)行設(shè)置以達(dá)到理想效果。設(shè)置好后

點(diǎn)擊Save進(jìn)行保存。然后可點(diǎn)擊Report進(jìn)行查看匹配結(jié)果。如下圖示:

3、顯示設(shè)置。

1)顯示之前必須把相應(yīng)的層打開。

PACKAGE GEOMETRY/PLACE_BOUND_TOP

PACKAGE GEOMETRY/PLACE_BOUND_BOTTOM

MANUFACTURING/STEP3D_ASSEMBLY_ENCLOSURE

2)設(shè)置3d顯示查看效果。

到這個(gè)步驟,漂亮的3D就做出來(lái)了,是不是很漂亮,那你也來(lái)試試吧!

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原文標(biāo)題:Cadence allegro 17.2 3DPCB設(shè)計(jì)詳解教程

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