關(guān)于16nm UltraScale+ 器件的工具與文檔分析和介紹

支持主流市場(chǎng)現(xiàn)在即可采用或者驗(yàn)證新一代器件，系統(tǒng)級(jí)性能功耗比將比28nm器件高2-5倍

賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX)）今天宣布支持16nm UltraScale+?系列的工具及文檔面向公眾公開(kāi)提供，其中包含Vivado? 設(shè)計(jì)套件HLx版、嵌入式軟件開(kāi)發(fā)工具、賽靈思Power Estimator （功耗評(píng)估器），以及用于Zynq? UltraScale+ MPSoC及Kintex? UltraScale+器件的技術(shù)文檔。設(shè)計(jì)開(kāi)發(fā)者們現(xiàn)在就可以在自己特定的設(shè)計(jì)上，通過(guò)UltraScale+產(chǎn)品系列實(shí)現(xiàn)比28nm器件高出2-5倍的系統(tǒng)級(jí)性能功耗比。這項(xiàng)發(fā)布標(biāo)志著針對(duì)16nm器件有了業(yè)界首款公開(kāi)可用的工具，為更廣大市場(chǎng)的采用提供了支持。通過(guò)與Vivado設(shè)計(jì)套件的協(xié)同優(yōu)化可以完全發(fā)揮UltraScale+產(chǎn)品系列的功耗性能比優(yōu)勢(shì)，以及SmartCORE?及LogiCORE? IP的完整目錄。此次發(fā)布延續(xù)了賽靈思在UltraScale+產(chǎn)品上所創(chuàng)造的一系列里程碑。其中包括2015年7月的首次投產(chǎn)與早期試用，2015年9月的首次出貨。

賽靈思FPGA與SoC產(chǎn)品管理和營(yíng)銷資深總監(jiān)Kirk Saban表示：“作為業(yè)界唯一公開(kāi)提供16nm可編程器件工具與文件的供應(yīng)商，賽靈思加速了主流市場(chǎng)采用最先進(jìn) SoC與FPGA的進(jìn)程。現(xiàn)在，所有客戶都能為其新一代應(yīng)用馬上驗(yàn)證UltraScale+產(chǎn)品系列卓越的系統(tǒng)級(jí)性能功耗比優(yōu)勢(shì)。

Vivado設(shè)計(jì)套件HLx版已可支持ZynqUltraScale+與KintexUltraScale+。賽靈思軟件設(shè)計(jì)工具、賽靈思Power Estimator與ZynqUltraScale+及KintexUltraScale+產(chǎn)品系列相關(guān)技術(shù)文檔也已開(kāi)放下載。欲了解更多相關(guān)資訊，請(qǐng)瀏覽賽靈思硬件開(kāi)發(fā)者專區(qū)與賽靈思軟件開(kāi)發(fā)者專區(qū)。

Vivado? 設(shè)計(jì)套件HLx版為All Programmable SoC、FPGA器件及打造可重用的平臺(tái)提供全新超高生產(chǎn)效率的設(shè)計(jì)方法。所有HLx版本的設(shè)計(jì)套件均具備C/C++函式庫(kù)、Vivado IP集成器(Vivado IPI)、LogicCORE? IP子系統(tǒng)等Vivado 高層次綜合 (Vivado HLS)技術(shù)，以及完整的Vivado建置工具套件，讓主流系統(tǒng)設(shè)計(jì)人員能夠方便地使用生產(chǎn)力最高、最先進(jìn)的C語(yǔ)言與IP設(shè)計(jì)流程。除此之外，當(dāng)設(shè)計(jì)人員將全新的UltraFast? 高生產(chǎn)力設(shè)計(jì)方法指南與這些工具一起使用，可較傳統(tǒng)的設(shè)計(jì)方法提升10至15倍的效率。

賽靈思16nmUltraScale+?系列FPGA、3D IC和MPSoC器件結(jié)合了全新記憶體、3D-on-3D和多重處理系統(tǒng)晶片(MPSoC)技術(shù)，實(shí)現(xiàn)了更高的性能和整合度，并包含SmartConnect互連最佳化技術(shù)。透過(guò)系統(tǒng)級(jí)最佳化，UltraScale+提供的價(jià)值遠(yuǎn)超過(guò)傳統(tǒng)制程節(jié)點(diǎn)轉(zhuǎn)換所能達(dá)到的水準(zhǔn)——可比28nm器件提供高出2-5倍的系統(tǒng)級(jí)性能功耗比，并擁有更高效的系統(tǒng)集成度和智能化，以及最高安全性和保密性。

Vivado設(shè)計(jì)套件HLx版已可支持ZynqUltraScale+和KintexUltraScale+。賽靈思軟件設(shè)計(jì)工具、賽靈思Power Estimator和 Zynq UltraScale+及Kintex UltraScale+ 產(chǎn)品系列相關(guān)技術(shù)文檔也已開(kāi)放。如需了解更多相關(guān)信息，請(qǐng)瀏覽賽靈思硬件開(kāi)發(fā)者專區(qū)和賽靈思軟件開(kāi)發(fā)者專區(qū)。

賽靈思是All Programmable FPGA、SoC、MPSoC和3D IC的全球領(lǐng)先供應(yīng)商，獨(dú)特地實(shí)現(xiàn)了兼具軟件定義和硬件最優(yōu)化的各種應(yīng)用，促進(jìn)云技術(shù)、SDN/NFV、視頻/視覺(jué)、工業(yè)物聯(lián)網(wǎng)以及5G 無(wú)線通信等產(chǎn)業(yè)的發(fā)展。如需了解更多信息，敬請(qǐng)?jiān)L問(wèn)賽靈思中文網(wǎng)站: 。

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FPGA(591969) FPGA(591969)
可編程(39058) 可編程(39058)
16nm(27843) 16nm(27843)

評(píng)論

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2018-11-21 06:11:00

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Zynq UltraScale+ MPSoC存儲(chǔ)器接口系統(tǒng)的介紹

該視頻重點(diǎn)介紹了UltraScale +產(chǎn)品系列的第一個(gè)成員Zynq?UltraScale+?MPSoC，并展示了使用可編程邏輯中的DDR4 SDRAM IP的存儲(chǔ)器接口系統(tǒng)的穩(wěn)健性。

2018-11-29 06:36:00

3044

如何將58Gb/s PAM4收發(fā)器集成到16nm Virtex UltraScale+ FPGA中

觀看本視頻了解賽靈思是如何將58Gb / s PAM4收發(fā)器集成到16nm Virtex UltraScale + FPGA系列產(chǎn)品中的。這些業(yè)界領(lǐng)先的高端FPGA可用于現(xiàn)有數(shù)據(jù)中心互連，5G

2018-11-28 06:45:05

2206

16nm UltraScale+ FPGA的集成100G以太網(wǎng)解決方案介紹

本視頻重點(diǎn)介紹了針對(duì)16nm UltraScale + FPGA和MPSoC的Xilinx集成100G以太網(wǎng)解決方案，增強(qiáng)了基于IEEE 802.3bj規(guī)范的Reed-Solomon前向糾錯(cuò)模塊（RS-FEC）模塊。

2018-11-28 06:40:00

4353

Zynq UltraScale+ MPSoC的發(fā)售消息

Zynq?UltraScale+?MPSoC，現(xiàn)已開(kāi)始發(fā)售。視頻向您重點(diǎn)介紹了Xilinx UltraScale +產(chǎn)品組合的第一位成員

2018-11-27 06:47:00

3262

Zynq UltraScale+ MPSoC器件的收發(fā)器技術(shù)演示

該視頻重點(diǎn)介紹了UltraScale +產(chǎn)品組合的第一個(gè)成員，Zynq?UltraScale+?MPSoC，以及其多樣化收發(fā)器技術(shù)的穩(wěn)健性。

2018-11-27 06:33:00

2501

Xilinx 16nm Virtex UltraScale+ FPGA器件的功能

在本視頻中，了解Xilinx采用高帶寬存儲(chǔ)器（HBM）和CCIX技術(shù)的16nm Virtex UltraScale + FPGA的功能和存儲(chǔ)器帶寬。

2018-11-27 06:20:00

3624

Xilinx 16nm Virtex UltraScale+ FPGA的展示

另一個(gè)行業(yè)首先，該演示展示了Xilinx 16nm Virtex UltraScale + FPGA，其集成的100G以太網(wǎng)MAC和RS-FEC協(xié)同工作，通過(guò)具有挑戰(zhàn)性的電氣或光學(xué)互連發(fā)送數(shù)據(jù)。

2018-11-27 05:55:00

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Xilinx 16nm UltraScale+系列產(chǎn)品的發(fā)布

賽靈思率先發(fā)布業(yè)界首款16nm產(chǎn)品，Xilinx 16nm UltraScale +系列產(chǎn)品（FPGA，3D IC和MPSoC）結(jié)合了全新的內(nèi)存，3D-on-3D，以及多處理SoC（MPSoC）技術(shù)

2018-11-22 06:49:00

4316

采用Zynq UltraScale+ MPSoC EV器件進(jìn)行4K編碼和解碼操作

本視頻向您演示了賽靈思16nm MPSoC產(chǎn)品系列的最新成員Zynq UltraScale + MPSoC EV器件的強(qiáng)大的實(shí)時(shí)視頻處理功能。該器件專為視頻處理等應(yīng)用優(yōu)化，集成H.264 / H.265視頻編解碼單元，能夠以每秒60幀的速率同時(shí)對(duì)視頻進(jìn)行4K編碼和解碼操作。

2018-11-22 05:51:00

4039

賽靈思最新發(fā)布的UltraScale+16nm系列FPGA、3D IC和MPSoC介紹

關(guān)鍵詞：UltraScale+ , MPSoC , 3D IC 引言在賽靈思 20nm UltraScale MT 系列成功基礎(chǔ)上，賽靈思現(xiàn)又推出了全新的 16nm UltraScale+ 系列

2018-12-28 00:02:02

832

賽靈思關(guān)于Zynq UltraScale+ RFSoC系列產(chǎn)品介紹

Zynq UltraScale+ RFSoC 在一款 SoC 架構(gòu)中集成數(shù)千兆采樣 RF 數(shù)據(jù)轉(zhuǎn)換器和軟判決前向糾錯(cuò) (SD-FEC)。

2019-07-26 15:43:55

5059

賽靈思公司宣布其Zynq UltraScale+ RFSoC系列開(kāi)始發(fā)貨

Zynq RFSoC 將 RF 數(shù)據(jù)轉(zhuǎn)換器、SD-FEC 內(nèi)核以及高性能 16nm UltraScale+ 可編程邏輯和 ARM 多處理系統(tǒng)完美集成在一起打造出了一個(gè)全面的模數(shù)信號(hào)鏈。

2019-07-29 11:54:45

2159

賽靈思開(kāi)始接受16nm器件訂單

All Programmable 技術(shù)和器件的全球領(lǐng)先企業(yè)賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX)）宣布：16nm UltraScale+ 產(chǎn)品組合提前達(dá)成重要的量產(chǎn)里程碑，本季度開(kāi)始接受量產(chǎn)器件訂單。

2019-08-01 16:10:44

2295

賽靈思擴(kuò)展SmartConnect技術(shù)為16nm UltraScale+器件實(shí)現(xiàn)性能突破

賽靈思 UltraScale+ 產(chǎn)品組合是業(yè)界唯一的一款基于 FinFET 的可編程技術(shù)。其包括 Zynq、Kintex 和 Virtex UltraScale+ 器件，相對(duì)于 28nm 產(chǎn)品而言,性能功耗比提升 2-5 倍，能支持 5G 無(wú)線、軟件定義網(wǎng)絡(luò)和下一代高級(jí)駕駛員輔助系統(tǒng)等市場(chǎng)領(lǐng)先應(yīng)用。

2019-07-30 16:08:26

2867

賽靈思公司宣布其Virtex UltraScale+ FPGA面向首批客戶開(kāi)始發(fā)貨

Virtex UltraScale+ 器件加上 Zynq UltraScale+ MPSoC 和 Kintex UltraScale+ FPGA展示了賽靈思16nm產(chǎn)品組合三大系列已經(jīng)悉數(shù)登場(chǎng)。

2019-07-30 17:14:49

2239

賽靈思公司宣布其已經(jīng)加入多核協(xié)會(huì)OpenAMP工作組

賽靈思的 OpenAMP 框架簡(jiǎn)化了異構(gòu)系統(tǒng)的開(kāi)發(fā)，并全面支持在業(yè)界首款投產(chǎn)的 16nm 多處理 Zynq UltraScale+ MPSoC 器件上實(shí)現(xiàn) OpenAMP。

2019-07-30 17:10:36

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賽靈思宣布支持16nm UltraScale+器件工具與文檔公開(kāi)支持主流市場(chǎng)

通過(guò)與 Vivado 設(shè)計(jì)套件的協(xié)同優(yōu)化可以完全發(fā)揮 UltraScale+ 產(chǎn)品系列的功耗性能比優(yōu)勢(shì)，以及 SmartCORE 及 LogiCORE IP 的完整目錄。此次發(fā)布延續(xù)了賽靈思在 UltraScale+ 產(chǎn)品上所創(chuàng)造的一系列里程碑。

2019-08-01 10:06:26

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Zynq UltraScale+ 器件與PL DNA不同的值

Xilinx 用兩個(gè) 96 位獨(dú)特器件標(biāo)識(shí)符（稱為器件 DNA）為每個(gè) Zynq UltraScale+ 器件編程。一個(gè) DNA 值位于可編程邏輯 (PL) 中，另一個(gè) DNA 值位于處理系統(tǒng) (PS) 中。這兩個(gè) DNA 值是不同的，但每個(gè) DNA 都有以下屬性及讀取訪問(wèn)方法。

2022-02-08 14:19:49

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UltraScale/UltraScale+的時(shí)鐘資源

UltraScale和UltraScale+進(jìn)一步增強(qiáng)了Clock root的概念，從芯片架構(gòu)和Vivado支持方面都體現(xiàn)了這一點(diǎn)。為了理解這一概念，我們先看看UltraScale/UltraScale+的時(shí)鐘資源。

2022-05-12 15:34:31

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