資料介紹
FPGA(現(xiàn)場可編程門陣列 )因其功能強大 、開發(fā)周期短 、可反復(fù)編程修改等特性 ,而在數(shù)字信號處理領(lǐng)域得到了廣泛應(yīng)用 。目前 FPGA 的設(shè)計調(diào)試環(huán)境 (如 QuartusⅡ 、ISE、M ode lsim 等 )中只能直觀地顯示仿真測試數(shù)據(jù)的時域波形 ,無法顯示數(shù)據(jù)的頻譜等特性 ,更不能以圖形的方法顯示數(shù)據(jù)的其他特征 ,因而在需要對測試結(jié)果進行進一步分析處理時 , 程序設(shè)計者無法直觀準確地判斷程序運行結(jié)果是否正確 ,給程序的設(shè)計及調(diào)試帶來一定的困難 。 MATLAB是一套功能十分強大的工程計算及數(shù)據(jù)分析軟件。由于其編程語言簡單直觀 , 被稱為 “演算紙式”科學(xué)算法語言, 已經(jīng)廣泛應(yīng)用于科研及教學(xué)工作中。本文提出將 FPGA設(shè)計環(huán)境中的測試數(shù)據(jù)通過文本文件格式傳遞給 MATLAB軟件, 再利用 MATLAB 軟件對數(shù)據(jù)進行分析處理, 并利用其強大的畫圖功能即可直觀地顯示所需的信號特征, 使測試結(jié)果更易于判斷, 進而給 FPGA的設(shè)計及調(diào)試帶來方便。本文首先簡要介紹 FPGA 的測試環(huán)境, 然后通過一個具體的例子詳細闡述數(shù)據(jù)在 FPGA 環(huán)境與 MATLAB環(huán)境中的傳遞方法 ,并給出相應(yīng)的 VHDL(甚高速集成電路硬件描述語言)及 MATLAB實現(xiàn)代碼。
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