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電子發(fā)燒友網(wǎng)>制造/封裝>半導(dǎo)體技術(shù)>半導(dǎo)體新聞>中芯國際(SMIC)和Cadence共同推出用于65納米的低

中芯國際(SMIC)和Cadence共同推出用于65納米的低

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2010-05-24 17:01:26660

Synopsys和中芯國際合作推出65-nm到40-nm的S

Synopsys和中芯國際合作推出65-nm到40-nm的SoC設(shè)計解決方案經(jīng)過驗證的聯(lián)合解決方案確保晶晨半導(dǎo)體達(dá)到以高性能產(chǎn)品搶占市場的目標(biāo)
2010-11-16 10:36:12830

瑞芯微電子與中芯國際合作推動65納米工藝多媒體高端芯片進(jìn)入量

瑞芯微電子與中芯國際合作推動65納米工藝多媒體高端芯片進(jìn)入量產(chǎn)  2010-11-29 16:30 上海2010年11月29日電 /美通社亞洲/ -- 作為國內(nèi)領(lǐng)先的半導(dǎo)體公司
2010-11-30 10:29:071044

Synopsys宣布提供經(jīng)中芯國際65nm低漏電工藝芯片驗證的DesignWare數(shù)據(jù)轉(zhuǎn)換器IP

新思科技有限公司日前宣布:該公司所提供經(jīng)芯片生產(chǎn)驗證的DesignWareTM數(shù)據(jù)轉(zhuǎn)換器IP,已被應(yīng)用于中芯國際廣受歡迎的65納米低漏電(Low Leakage)工藝技術(shù)
2011-04-21 09:57:061043

Spansion與中芯國際擴展65納米產(chǎn)能并制造45納米閃存記憶體

Spansion與中芯國際宣布雙方將延伸目前的代工協(xié)議以擴展中芯目前的65納米代工產(chǎn)能,并將為Spansion制造其45納米閃存記憶體。
2011-05-17 08:03:29680

Cadence推出28納米的可靠數(shù)字端到端流程

即將上市的這種新流程支持Cadence的硅實現(xiàn)方法,專注于獨一無二且普遍深入的設(shè)計意圖、提取與從RTL到GDSII,然后到封裝。硅實現(xiàn)是EDA360構(gòu)想的一個關(guān)鍵組成部分。
2011-06-28 09:44:23455

英飛凌推出65納米嵌入式閃存微控制器樣品

英飛凌科技股份公司(FSE: IFX / OTCQX: IFNNY)近日宣布推出首款面向芯片卡和安全應(yīng)用的65納米嵌入式閃存(eFlash)微控制器(MCU)樣品。這是英飛凌和臺積電(TSMC)于2009年開始共同開發(fā)及生產(chǎn)65 納米
2011-11-19 00:13:18543

集成電路里程碑:三星與Cadence合推20納米設(shè)計方法

Cadence與三星的合作為移動消費電子產(chǎn)品帶來了新的工藝進(jìn)展,使得20納米及未來工藝節(jié)點設(shè)計成為可能。
2012-06-10 10:43:54984

TSMC 20納米的設(shè)計架構(gòu)選擇Cadence解決方案

全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司日前宣布TSMC已選擇Cadence解決方案作為其20納米的設(shè)計架構(gòu)。Cadence解決方案包括Virtuoso定制/模擬以及Encounter RTL-to-Signoff平臺。
2012-10-22 16:48:03909

Cadence采用FinFET技術(shù)流片14納米芯片

該14納米產(chǎn)品體系與芯片是ARM、Cadence與IBM之間在14納米及以上高級工藝節(jié)點上開發(fā)系統(tǒng)級芯片(SoC)多年努力的重要里程碑。使用FinFET技術(shù)以14納米標(biāo)準(zhǔn)設(shè)計的SoC能夠大幅降低功耗。 這
2012-11-16 14:35:551270

Cadence和GLOBALFOUNDRIES合作改進(jìn)20及14納米節(jié)點DFM簽收

全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ:CDNS)近日宣布,GLOBALFOUNDRIES已攜手Cadence?,為其20和14納米制程提供模式分類數(shù)據(jù)
2013-05-13 10:20:02770

Cadence解決方案助力創(chuàng)意電子20納米SoC測試芯片成功流片

光刻物理分析器成功完成20納米系統(tǒng)級芯片(SoC)測試芯片流片。雙方工程師通過緊密合作,運用Cadence解決方案克服實施和可制造性設(shè)計(DFM)驗證挑戰(zhàn),并最終完成設(shè)計。
2013-07-09 15:53:24769

華力微電子與Cadence共同宣布交付55納米平臺的參考設(shè)計流程

全球電子創(chuàng)新設(shè)計Cadence公司與上海華力微電子,15日共同宣布了華力微電子基于Cadence Encounter數(shù)字技術(shù)交付55納米平臺的參考設(shè)計流程。華力微電子首次在其已建立55納米工藝上實現(xiàn)了從RTL到GDSII的完整流程。
2013-08-16 11:08:111383

華力微電子基于Cadence Encounter開發(fā)55納米平臺的參考設(shè)計流程

全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ:CDNS)與上海華力微電子有限公司,今天共同宣布華力微電子基于Cadence ? Encounter? 數(shù)字技術(shù)交付出55納米平臺的參考設(shè)計流程。
2013-08-16 12:02:401445

中芯國際采用Cadence數(shù)字流程 提升40納米芯片設(shè)計能力

中芯國際新款40納米 Reference Flow5.1結(jié)合了最先進(jìn)的Cadence CCOpt和GigaOpt工藝以及Tempus 時序簽收解決方案, 新款RTL-to-GDSII數(shù)字流程支持Cadence的分層低功耗流程和最新版本的通用功率格式(CPF).
2013-09-05 10:45:031839

中芯國際采用Cadence數(shù)字流程 新增高級功能,以節(jié)省面積、降低功耗和提高性能

? 數(shù)字工具流程,應(yīng)用于其新款SMIC Reference Flow 5.1,一款為低功耗設(shè)計的完整的RTL-GDSII 數(shù)字流程。Cadence流程結(jié)合了先進(jìn)功能,以幫助客戶為40納米芯片設(shè)計提高功率、性能和面積。
2013-09-05 16:50:41748

Cadence與GLOBALFOUNDRIES宣布最新合作成果

益華電腦宣布,晶圓代工業(yè)者GLOBALFOUNDRIES已經(jīng)認(rèn)證Cadence實體驗證系統(tǒng)適用于65nm至14nm FinFET制程技術(shù)的客制/類比、數(shù)位與混合訊號設(shè)計實體signoff。同時
2014-03-25 09:33:50862

Cadence宣布推出基于臺積電16納米FinFET制程DDR4 PHY IP

全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS)今天宣布,立即推出基于臺積電16納米FinFET制程的DDR4 PHY IP(知識產(chǎn)權(quán))。
2014-05-21 09:44:541769

Cadence為臺積電16納米FinFET+制程推出IP組合

美國加州圣何塞(2014年9月26日)-全球知名的電子設(shè)計創(chuàng)新領(lǐng)導(dǎo)者Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS)今日宣布為臺積電16納米FinFET+ 制程推出一系列IP組合。
2014-10-08 19:19:22919

SMIC為IP認(rèn)證方案添加可靠性檢查

中芯國際集成電路制造有限公司(Semiconductor Manufacturing International Corporation, SMIC) 將在其IP認(rèn)證計劃中加入新的電路可靠性檢查,使用 Calibre? PERC? 產(chǎn)品
2015-07-01 13:40:171299

中芯國際推出28納米HKMG制程,與聯(lián)芯打造智能手機SoC芯片

納米高介電常數(shù)金屬閘極(HKMG)制程已成功流片,基于此平臺,聯(lián)芯科技推出用于智能手機等領(lǐng)域的28納米SoC芯片,包括高性能應(yīng)用處理器和移動基帶功能,目前已通過驗證,準(zhǔn)備進(jìn)入量產(chǎn)階段。
2016-02-17 14:00:301396

Cadence工具獲臺積電7納米早期設(shè)計及10納米芯片生產(chǎn)認(rèn)證

2016年3月22日,中國上海——楷登電子(美國 Cadence 公司,NASDAQ: CDNS)今日宣布,用于10納米 FinFET工藝的數(shù)字、定制/模擬和簽核工具通過臺積電(TSMC)V1.0設(shè)計參考手冊(DRM)及SPICE認(rèn)證。
2016-03-22 13:54:541026

CadenceSMIC 聯(lián)合發(fā)布低功耗 28納米數(shù)字設(shè)計參考流程

“我們與 Cadence 密切合作開發(fā)參考流程,幫助我們的客戶加快其差異化的低功耗、高性能芯片的設(shè)計,”中芯國際設(shè)計服務(wù)中心資深副總裁湯天申博士表示,“Cadence創(chuàng)新的數(shù)字實現(xiàn)工具與中芯國際28納米工藝的緊密結(jié)合,能夠幫助設(shè)計團(tuán)隊將28納米設(shè)計達(dá)到更低的功耗以及更快的量產(chǎn)化?!?/div>
2016-06-08 16:09:562242

4巨頭強強聯(lián)手合作開發(fā)7納米工藝CCIX測試芯片

賽靈思、Arm、Cadence和臺積公司今日宣布一項合作,將共同構(gòu)建首款基于臺積7納米FinFET工藝的支持芯片間緩存一致性(CCIX)的加速器測試芯片,并計劃在2018年交付
2017-09-23 10:32:124003

基于CCopt引擎的SMIC40nm低功耗工藝CortexA9的時鐘樹實現(xiàn)

基于CCopt引擎的SMIC40nm低功耗工藝CortexA9的時鐘樹實現(xiàn),該文基于 SMIC 40nm 低功耗工藝的 ARM Cortex A9 物理設(shè)計的實際情況,詳細(xì)闡述了如何使用 cadence 最新的時鐘同步優(yōu)化技術(shù),又稱為 CCopt 技術(shù)來實現(xiàn)統(tǒng)一的時鐘樹綜合和物理優(yōu)化。
2017-09-28 09:08:517

Cadence 公司的射頻設(shè)計方案走向中國市場

Cadence Design Systems, Inc. 和中芯國際,11月共同宣布將 Cadence 公司的射頻設(shè)計方案 (Radio Frequency Design Methodology
2017-12-13 14:21:011568

中芯國際推進(jìn)14納米產(chǎn)量_中芯國際面臨本土市場競爭

中芯國際14納米將正式啟動大展拳腳。30日晚間,中芯國際宣布,由中芯控股、國家“大基金”、上海集成電路基金共同注資“中芯南方”。注資后,中芯南方注冊資本增至35億美元,同時中芯南方未來也將肩負(fù)配合中芯14納米及以下先進(jìn)制程研發(fā)和量產(chǎn)計劃,打造月產(chǎn)能3.5萬片12吋晶圓廠。
2018-02-01 10:58:307505

Cadence的10Gbps多協(xié)議PHY研發(fā)成功,可與控制器進(jìn)行無縫對接

5月14日, Cadence宣布基于中芯國際14nm工藝的10Gbps多協(xié)議PHY研發(fā)成功,這是行業(yè)首個SMIC FinFET工藝上有成功測試芯片的多協(xié)議SerDes PHY IP。
2020-05-14 15:36:442619

美國正式“打壓”中芯國際

昨日晚間,美商務(wù)部將中芯國際列入實體清單的消息引發(fā)關(guān)注。當(dāng)?shù)貢r間周五,美國商務(wù)部工業(yè)和安全局(BIS)正式宣布將中國半導(dǎo)體制造企業(yè)中芯國際SMIC)列入實體清單。根據(jù)細(xì)則,中芯國際在先進(jìn)技術(shù)節(jié)點(10納米或以下)生產(chǎn)半導(dǎo)體面臨全面封禁。
2020-12-19 09:28:542191

Cadence宣布推出Cadence Safety Solution安全方案

Cadence 驗證引擎,支持完整的 ISO 26262 和 IEC 61508 驗證 中國上海,2021 年 10 月 20 日——楷登電子(美國 Cadence 公司,NASDAQ:CDNS)宣布推出 Cadence Safety Solution 安全方案。這是一款
2021-10-26 14:24:344050

中芯國際停止擴大28納米半導(dǎo)體生產(chǎn)的決定

中芯國際是中國大陸最大的半導(dǎo)體制造企業(yè)之一,主要業(yè)務(wù)是為其他半導(dǎo)體公司生產(chǎn)晶片。暫時中斷28納米芯片的生產(chǎn)擴大,將致力于提高12納米節(jié)點的生產(chǎn)能力。smic的決定是出于經(jīng)濟上的原因。
2023-06-01 10:50:211485

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