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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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AMBA4 SystemVerilog Asseration驗(yàn)證
ARM所推出的AMBA4總線相對(duì)來(lái)講還是應(yīng)用廣泛的。無(wú)論是芯片設(shè)計(jì)里還是FPGA設(shè)計(jì)里,時(shí)常能見(jiàn)到AMBA4總線的身影。
2023-05-05 標(biāo)簽:armFPGA設(shè)計(jì)AMBA總線 702 0
驗(yàn)證必備:AMBA4 SystemVerilog Asseration
ARM所推出的AMBA4總線相對(duì)來(lái)講還是應(yīng)用廣泛的。無(wú)論是芯片設(shè)計(jì)里還是FPGA設(shè)計(jì)里,時(shí)常能見(jiàn)到AMBA4總線的身影。
2023-05-24 標(biāo)簽:FPGA設(shè)計(jì)AMBA總線ARM處理器 701 0
多片F(xiàn)PGA原型驗(yàn)證的限制因素有哪些?
當(dāng)SoC系統(tǒng)的規(guī)模很大的時(shí)候,單片F(xiàn)PGA驗(yàn)證平臺(tái)已經(jīng)無(wú)法容納這么多容量,我們將采取將SoC設(shè)計(jì)劃分為多個(gè)FPGA的映射。
2023-06-19 標(biāo)簽:FPGA設(shè)計(jì)連接器TDM 675 0
FPGA設(shè)計(jì)-時(shí)序約束實(shí)例分析
現(xiàn)有一塊ADC連接到FPGA上,需要在FPGA上實(shí)現(xiàn)高速數(shù)據(jù)的讀取,那么第一步自然就是完成可靠的硬件連線
2023-06-28 標(biāo)簽:FPGA設(shè)計(jì)寄存器TTL電路 673 0
影響FPGA設(shè)計(jì)周期生產(chǎn)力的最大因素是什么?
提高FPGA設(shè)計(jì)生產(chǎn)力的工具、技巧和方法,9影響FPGA設(shè)計(jì)周期生產(chǎn)力的最大因素是什么?
2017-02-11 標(biāo)簽:FPGAFPGA設(shè)計(jì)時(shí)序 644 0
如何實(shí)現(xiàn)一種EEPROM驅(qū)動(dòng)設(shè)計(jì)?
EEPROM (Electrically Erasable Programmable read only memory)是指帶電可擦可編程只讀存儲(chǔ)器。
2023-08-24 標(biāo)簽:fpgaFPGA設(shè)計(jì)存儲(chǔ)器 638 0
FPGA浮點(diǎn)IP內(nèi)核究竟有哪些優(yōu)勢(shì)呢?
最近出現(xiàn)的 FPGA設(shè)計(jì)工具和 IP有效減少了計(jì)算占用的資源,大大簡(jiǎn)化了浮點(diǎn)數(shù)據(jù)通路的實(shí)現(xiàn)。而且,與數(shù)字信號(hào)處理器不同
2023-09-25 標(biāo)簽:dspFPGA設(shè)計(jì)乘法器 637 0
基于Xilinx K7-410T的高速DAC之AD9129開(kāi)發(fā)筆記(一)
本文開(kāi)始,我們介紹下項(xiàng)目中設(shè)計(jì)的并行LVDS高速DAC接口設(shè)計(jì),包括DAC與FPGA硬件接口設(shè)計(jì)、軟件設(shè)計(jì)等。
2023-06-07 標(biāo)簽:FPGA設(shè)計(jì)dac數(shù)模轉(zhuǎn)換器 636 0
FPGA如何能讓程序員們更友好的開(kāi)發(fā)編程呢?
對(duì)于一個(gè)軟件開(kāi)發(fā)人員,可能聽(tīng)說(shuō)過(guò) FPGA,甚至在大學(xué)課程設(shè)計(jì)中,可能拿FPGA做過(guò)計(jì)算機(jī)體系架構(gòu)相關(guān)的驗(yàn)證,但是對(duì)于它的第一印象可能覺(jué)得這是硬件工程師...
2023-08-25 標(biāo)簽:FPGA設(shè)計(jì)人工智能RTL 633 0
怎么去設(shè)計(jì)一種基于FPGA的擴(kuò)頻模塊呢?
擴(kuò)頻系統(tǒng)最早可以追溯到20世紀(jì)20年代左右,擴(kuò)頻通信就有了初步的應(yīng)用。但是一直到20世紀(jì)年代中期,擴(kuò)頻系統(tǒng)才真正應(yīng)用和發(fā)展起來(lái)。
2023-07-31 標(biāo)簽:fpgaFPGA設(shè)計(jì)接收機(jī) 602 0
FPGA設(shè)計(jì)-時(shí)序約束(理論篇)
STA(Static Timing Analysis,即靜態(tài)時(shí)序分析)在實(shí)際FPGA設(shè)計(jì)過(guò)程中的重要性是不言而喻的
2023-06-26 標(biāo)簽:FPGA設(shè)計(jì)寄存器觸發(fā)器 590 0
處理FPGA原型設(shè)計(jì)需要多長(zhǎng)時(shí)間?
FPGA設(shè)計(jì)的五個(gè)主要任務(wù):邏輯綜合、門級(jí)映射、整體功能邏輯布局、邏輯資源互連布線
2023-05-23 標(biāo)簽:FPGA設(shè)計(jì)EDA工具RTL 574 0
如何實(shí)現(xiàn)一種基于FPGA的橫向FIR濾波器設(shè)計(jì)?
設(shè)經(jīng)過(guò)AD采集得到的輸入序列為x(n),其通過(guò)單位沖激響應(yīng)為h(n)的因果FIR濾波器后,輸出y(n)在時(shí)域可表示為線性卷積和的形式
2023-07-25 標(biāo)簽:FPGA設(shè)計(jì)寄存器fir濾波器 565 0
對(duì)FPGA設(shè)計(jì)而言如果想速度更快則應(yīng)當(dāng)努力減少路徑上LUT的個(gè)數(shù),而不是邏輯級(jí)數(shù)。
2023-12-27 標(biāo)簽:FPGA設(shè)計(jì)LUT 560 0
FPGA基礎(chǔ)設(shè)計(jì)之使用邏輯門和連續(xù)賦值對(duì)電路建模
使用邏輯門和連續(xù)賦值對(duì)電路建模,是相對(duì)詳細(xì)的描述硬件的方法。使用過(guò)程塊可以從更高層次的角度描述一個(gè)系統(tǒng),稱作行為級(jí)建模(behavirol modeling)。
2023-02-08 標(biāo)簽:FPGA設(shè)計(jì)編碼器Verilog 552 0
FPGA時(shí)序約束理論篇之時(shí)序路徑與時(shí)序模型
典型的時(shí)序路徑有4類,如下圖所示,這4類路徑可分為片間路徑(標(biāo)記①和標(biāo)記③)和片內(nèi)路徑(標(biāo)記②和標(biāo)記④)。
2023-06-26 標(biāo)簽:FPGA設(shè)計(jì)寄存器觸發(fā)器 540 0
IIC協(xié)議驅(qū)動(dòng)設(shè)計(jì)
I2C 即 Inter-Integrated Circuit(集成電路總線),這種總線類型是由飛利浦半導(dǎo)體公司在八十年代初設(shè)計(jì)出來(lái)的一種簡(jiǎn)單、雙向、二線...
2023-07-17 標(biāo)簽:FPGA設(shè)計(jì)EEPROMSDA 518 0
在FPGA設(shè)計(jì)中,我們經(jīng)常會(huì)碰到這樣的情形:從快時(shí)鐘域到慢時(shí)鐘域完成位寬轉(zhuǎn)換,這時(shí),這兩個(gè)時(shí)鐘是同步的。例如:源時(shí)鐘是400MHz,數(shù)據(jù)位寬為4;目的時(shí)...
2023-09-07 標(biāo)簽:fpgaFPGA設(shè)計(jì)寄存器 503 0
如何利用萊迪思宏設(shè)計(jì)流程縮短FPGA設(shè)計(jì)周期
隨著FPGA密度和復(fù)雜性的提高,設(shè)計(jì)團(tuán)隊(duì)會(huì)將之前由其他類型的半導(dǎo)體(如ASIC和MCU)處理的設(shè)計(jì)遷移到這些更復(fù)雜的FPGA上。
2023-07-06 標(biāo)簽:濾波器FPGA設(shè)計(jì)寄存器 498 0
請(qǐng)問(wèn)FPGA數(shù)字IO如何實(shí)現(xiàn)DAC功能呢?
假設(shè)方波頻率為f0。橫軸諧波次數(shù)為0的柱狀圖代表直流分量的幅值,也就是方波的平均電壓(與占空比有關(guān)),諧波次數(shù)為1代表頻率為f0的正弦波分量的幅值,3代...
2023-06-28 標(biāo)簽:濾波器FPGA設(shè)計(jì)低通濾波器 481 0
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