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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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OFDM收發(fā)機的設(shè)計框架、調(diào)制與解調(diào)
本篇我們聚焦OFDM的基本原理,討論OFDM收發(fā)機的設(shè)計框架、調(diào)制與解調(diào)(IFFT/FFT)、正交性、保護(hù)間隔、循環(huán)前綴,并分析其優(yōu)缺點。
2023-07-07 標(biāo)簽:FPGA設(shè)計通信系統(tǒng)SoC芯片 1295 0
在設(shè)計雙邊沿采樣電路(Dual-edge triggered flip-flop)之前,先從單邊沿采樣電路設(shè)計(Edge capture registe...
2023-06-05 標(biāo)簽:FPGA設(shè)計寄存器采樣電路 1293 0
FPGA設(shè)計全流程:ModelsimSynplify.ProISE
介紹如何編譯HDL必須的Xilinx庫和結(jié)構(gòu)仿真。創(chuàng)建將被編譯庫的目錄在編譯庫之前,最好先建立一個目錄(事實上必須建立一個目錄),步驟如下
2017-02-11 標(biāo)簽:FPGAFPGA設(shè)計Xilinx 1288 0
賽靈思FPGA設(shè)計技巧與應(yīng)用創(chuàng)新(二)
前面的博文中已經(jīng)提到了基于Sigma-Delta ADC采樣的數(shù)據(jù)采集系統(tǒng),并詳細(xì)說了Sinc3抽樣濾波器的設(shè)計方法,在有詳細(xì)介紹。后來將前面的ADC也...
2017-02-11 標(biāo)簽:FPGAFPGA設(shè)計賽靈思 1286 0
FPGA設(shè)計中的絕大部分電路為同步時序電路,其基本模型為“寄存器+組合邏輯+寄存器”。同步意味著時序路徑上的所有寄存器在時鐘信號的驅(qū)動下步調(diào)一致地運作。
2023-08-03 標(biāo)簽:fpgaFPGA設(shè)計寄存器 1286 0
【Soc級系統(tǒng)防御】Soc硬件木馬與電子鏈學(xué)習(xí)
隨著尖端工藝的代工成本和現(xiàn)代片上系統(tǒng)(system-on-a-chip,SoC)平臺設(shè)計復(fù)雜性的不斷提高,曾經(jīng)局限于一個國家甚至一家公司的IC供應(yīng)鏈已經(jīng)...
2023-11-20 標(biāo)簽:處理器FPGA設(shè)計場效應(yīng)晶體管 1283 0
在ASIC/FPGA項目中,我們會用到很多IP,其中有很多IP存在內(nèi)部控制信號以及內(nèi)部狀態(tài)信號。
2023-09-15 標(biāo)簽:fpga控制器FPGA設(shè)計 1277 0
加、減 使用補碼時,加減法可以統(tǒng)一,因而對加減不加區(qū)分,對有無符號也不加以區(qū)分。
2023-06-06 標(biāo)簽:FPGA設(shè)計Verilog 1270 0
如何在FPGA設(shè)計環(huán)境中加入時序約束?
在給FPGA做邏輯綜合和布局布線時,需要在工具中設(shè)定時序的約束。通常,在FPGA設(shè)計工具中都FPGA中包含有4種路徑:從輸入端口到寄存器,從寄存器到寄存...
2023-10-12 標(biāo)簽:fpgaFPGA設(shè)計時鐘 1261 0
如何使用FPGA來設(shè)計智能網(wǎng)卡(SmartNIC)?
智能服務(wù)器適配器或智能網(wǎng)卡(SmartNIC)通過從服務(wù)器的CPU上卸載網(wǎng)絡(luò)處理工作負(fù)載和任務(wù),提高云端和私有數(shù)據(jù)中心中的服務(wù)器性能。
2023-07-27 標(biāo)簽:處理器fpgaFPGA設(shè)計 1231 0
FPGA 非常適合精密電機控制,在這個項目中,我們將創(chuàng)建一個簡單的電機控制程序,在此基礎(chǔ)上可以構(gòu)建更復(fù)雜的應(yīng)用。
2023-08-11 標(biāo)簽:微控制器fpgaFPGA設(shè)計 1223 0
一般來說,面積是一個設(shè)計所消耗的目標(biāo)器件的硬件資源數(shù)量或者ASIC芯片的面積。
2023-06-05 標(biāo)簽:FPGA設(shè)計加法器RTL 1221 0
如何建立適合團隊的FPGA原型驗證系統(tǒng)平臺與技術(shù)?
FPGA原型驗證在數(shù)字SoC系統(tǒng)項目當(dāng)中已經(jīng)非常普遍且非常重要,但對于一個SoC的項目而言,選擇合適的FPGA原型驗證系統(tǒng)顯的格外重要
2023-04-03 標(biāo)簽:FPGA設(shè)計存儲器RAM 1218 0
眾所周知,小波變換的雙正交基就來自與小波函數(shù)和尺度函數(shù),而他們通過scale和平移來得到的小波函數(shù)族和尺度函數(shù)族表示了不同小波(尺度)函數(shù)的分辨率
2023-06-27 標(biāo)簽:濾波器FPGA設(shè)計小波變換 1209 0
FPGA項目開發(fā)的過程中,需要完成設(shè)計代碼開發(fā)、驗證環(huán)境搭建、仿真分析、板級驗證等操作,在這個過程中,許多操作雖然必不可少但是步驟是重復(fù)的。
2023-09-27 標(biāo)簽:fpgaFPGA設(shè)計仿真 1180 0
論工業(yè)控制系統(tǒng)的FPGA設(shè)計方法(2)
上次博文簡要介紹了人們研究使用FPGA來進(jìn)行工業(yè)控制的驅(qū)動力與FPGA器件與工具的介紹,本次介紹FPGA設(shè)計方法論中的FPGA體系及其開發(fā)工具介紹。
2017-02-11 標(biāo)簽:FPGAFPGA設(shè)計工業(yè)控制 1170 0
通過小腳丫FPGA核心開發(fā)板來進(jìn)行門電路的設(shè)計
在數(shù)字電路中,門電路是最基本的構(gòu)成單位,可以說,任何復(fù)雜的數(shù)字電路系統(tǒng)都可以通過我們耳熟能詳?shù)呐c門,非門,或門,與非門,異或門等等組合實現(xiàn)。
2023-06-20 標(biāo)簽:FPGA設(shè)計led燈MOS管 1167 0
FPGA時序分析-建立時間和保持時間裕量都是inf怎么解決呢?
今天有個小伙伴遇到一個問題,就是在vivado里面綜合后看到的建立時間和保持時間裕量都是inf,我們來看看怎么解決這個問題。
2023-07-30 標(biāo)簽:fpgaFPGA設(shè)計寄存器 1163 0
FIFO為什么不能正常工作?復(fù)位信號有效長度不夠,接口時序不匹配,可看下面這篇文章。 本文將介紹: 非DFX工程如何確保異步FIFO自帶的set_max...
2023-11-02 標(biāo)簽:fpgaFPGA設(shè)計fifo 1148 0
下圖給出了反相器相位插指器的基本結(jié)構(gòu)。結(jié)構(gòu)很簡單,兩個反相器陣列輸入分別接兩個時鐘,輸出直接短接在一起,數(shù)字信號控制反相器陣列選通的數(shù)目。
2023-06-21 標(biāo)簽:FPGA設(shè)計寄存器存儲器 1144 0
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